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EMA TimingDesigner

Résolument dédié à une utilisation en phase de pré-étude

Spécifications, analyse et documentation de diagrammes de temps

TimingDesigner est l’outil d’analyse temporelle interactif plébiscité par les concepteurs qui souhaitent  obtenir rapidement des résultats précis pour leurs projets high-speed et multifréquences.
TimingDesigner utilise un diagramme temporel intuitif  pour développer les spécifications de leurs conceptions, analyser le timing afin de répondre aux besoins de conceptions spécifiques et documenter les résultats dans le but d’illustrer et communiquer très clairement la mise en place du système. Pour ces conceptions, il est donc essentiel de modéliser et analyser précisément les relations entre les composants sur une carte entre les fonctions embarquées sur un ASIC ou un circuit intégré programmable.
TimingDesigner peut évaluer des ensembles complets d’alternatives temporelles et fournir une direction aux défis temporels les plus complexes, ce qui permet aux concepteurs de gérer et de surveiller les marges de temps lors du processus de conception.

 

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Filières de formation

 

Parce que la formation est une affaire de spécialistes, Artedas a mis tout en œuvre pour que vous tiriez le meilleur parti de vos outils ! Quel que soit votre niveau, trouvez la formation qui vous convient.

 

Avantages de TimingDesigner

  • Le diagramme temporel convivial fournit rapidement une estimation des caractéristiques du système
  • Logiciel lié dynamiquement à un tableur temporel afin de modéliser précisément les effets des contraintes et des délais
  • Ce logiciel très puissant d’analyse temporelle identifie rapidement les marges temporelles les plus critiques
  • Les mises à jour instantanées des diagrammes temporels effectuent des évaluations rapides de différents scénarii
  • Gestionnaire de projet fiable
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Evaluation rapide d’alternatives

L’évaluation d’alternatives est la clé pour développer des spécifications qui peuvent fournir précisément des détails de conception.
TimingDesigner contient un diagramme temporel convivial qui permet la spécification rapide de caractéristiques de conception dont : contraintes temporelles, relations de cause à effet, délais, protocoles de séquence. TimingDesigner permet de réaliser très tôt dans la conception des investigations concernant les options de timing et fournit ainsi un moyen simple pour spécifier clairement la séquence des événements et les relations de timing nécessaires à la bonne communication entre les modules ou les sous-systèmes.

Analyse d’interfaces

Les interfaces entre processeurs, mémoire et fonctions logiques intégrées sur une puce ou entre les composants d’une carte sont souvent la source de violations de timing difficile à localiser, et ce plus particulièrement pour les conceptions high-speed.
Le moteur temporel très puissant de TimingDesigner utilise un diagramme pour analyser précisément les paramètres et identifier les violations qui ne seraient alors détectées qu’une fois le processus de conception bien avancé. La capacité à rapidement évaluer les alternatives de conception et à calculer les marges temporelles pire-cas fait de TimingDesigner le meilleur choix d'aide au développement de solutions aux problèmes spécifiques.  

Documentation

TimingDesigner offre la capacité de communiquer clairement et précisément les détails de conception en exportant ou en reliant des documents concernant les fichiers de timing réalisés pendant le processus de conception à travers des liens OLE ou dans son format d’origine. Le format standard, facilement interprétable, des spécifications du diagramme temporel améliore la communication de l'information pour les conceptions complexes. De plus, le puissant gestionnaire de projet organise les diagrammes des composants à travers une simple arborescence et facilite la gestion et l’échange des données temporelles parmi les membres de l’équipe de conception.

Analyse avancée des propagations de délais

TimingDesigner recense tous les  propagations de délais spécifiés dans le diagramme temporel, il élimine certaines incertitudes communes, effectue des ajustements pour les délais, et sélectionne les chemins critiques puis calcule les marges temporelles pire cas. Les répercussions des modifications des conceptions complexes sont immédiatement identifiées. Les contraintes temporelles calculées automatiquement soulignent les violations temporelles en rouge et les fait apparaître dans une fenêtre de rapport afin que les problèmes puissent être rapidement résolus. Un format configurable permettant de générer des rapports et d’exporter des informations sur les contraintes temporelles est disponible en utilisant la fenêtre "Dynamic Text".


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