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OrCAD Capture XJTAG DFT Assistant

Conception en vue du test (Design for Test)

Réaliser la conception des contrôles de test (DFT) de vos projets pendant l'étape de schématisation

Développée par XJTAG, fournisseur d’outils logiciels et matériels « boundary-scan », l’interface XJTAG DFT Assistant permet de détecter et de corriger les erreurs JTAG sur les cartes électroniques au stade de la conception, c’est-à-dire avant l’entrée en production. Cette intervention effectuée en amont évite de procéder à des coûteuses reprises, ainsi que de retarder les projets en cours. XJTAG permet de raccourcir considérablement le processus de conception, de développement et de fabrication des circuits, et permet également d’améliorer le déboguage et les tests dans l’ensemble du cycle de vie du produit.

 

 

Annonce press de l'Assistant XJTAG DFT pour OrCAD Capture

Télécharger l'Assistant XJTAG DFT pour OrCAD Capture

Manuel d'installation et d'utilisation

 

Brochure détaillée

OrCAD

Voir aussi ..

 

OrCAD™ Capture est le standard des schématiques industrielles dédié à la simulation A/D et au développement de PCB : son éditeur de schéma intuitif, sa gestion de projet, sa compatibilité et son prix en sont les atouts clés

Une solution PCB complète

 

PCB Designer Standard met à votre disposition tous les outils dont vous avez besoin pour concevoir vos cartes de circuits imprimés

 

Filières de formation

 

Parce que la formation est une affaire de spécialistes, Artedas a mis tout en œuvre pour que vous tiriez le meilleur parti de vos outils ! Quel que soit votre niveau, trouvez la formation qui vous convient.

 

Avantages de l'Assistant XJTAG DFT

  • Parfaite integration dans OrCAD Capture ( V17.2-2016 QIR 2 et suppérieure )
  • Afin de procéder rapidement à une analyse JTAG DFT, l'Assistant XJTAG DFT comprend un configurateur de projet très simple à mettre en œuvre
  • Importation automatique de la netlist à partir d'OrCAD Capture
  • Comprend le visualisateur JTAG Access Viewer qui montre clairement quelle proportion du projet est accessible et peut être testée à l'aide de JTAG (dans Capture, les nets sont codées par couleur pour indiquer l'accessibilité)
  • Analyse et propose également des conseils pour résoudre certains problèmes de conception qui pourraient empêcher le Boundary Scan de fonctionner
  • Affiche trois catégories d'erreurs : connection, terminaison et conformité
  • Catégorisation assistée de composants logiques et passifs afin d'étendre les chaînes de Boudary Scan
  • Analyse les nets dans une page de saisie de schémas et détecte les erreurs potentielles dans les chaînes du Boundary Scan
  • Illustre quelle proportion du circuit est accessible aux essais à l'aide d'équipement de test JTAG avant le lancement du routage ou la fabrication
  • En utilisant XJDeveloper, il est facile de créer ou personnaliser des tests avec les outils intégrés, y compris des outils pour l’Analyse DFT. Vous pouvez également programmer les composants JTAG (CPLD, FPGA, etc) et non JTAG (Flash, EEPROMs) avec XJDeveloper
E-demo   Vous voulez en savoir plus ? Demandez une démonstration en ligne gratuite  >

XJTAG Access Viewer

XJTAG Access Viewer « superpose » le périmètre de test « bounday scan » sur le schéma, ce qui permet à l’utilisateur de savoir instantanément quels composants sont accessibles à l’aide de l’outil « boundary scan » et où la couverture de tests peut être étendue. Les ingénieurs peuvent mettre en évidence les interconnexions séparément en vue d’afficher sur le schéma les accès en lecture, écriture, les alimentations, ainsi que les interconnexions sans accès JTAG

XJTAG Chain Checker

XJTAG Chain Checker identifie les erreurs courantes dans une chaîne d’analyse JTAG, tels que les ports d’accès de test (TAP) mal raccordés et connectés, et en informe le développeur. Dans le cas contraire, la moindre erreur de branchement empêchera le bon fonctionnement de l’intégralité de la chaîne d’analyse


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